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Benchmark revela o dobro de cache L3 por CCX em processadores Epyc Zen 2 "Rome"

Benchmark revela o dobro de cache L3 por CCX em processadores Epyc Zen 2 "Rome"

26/11/2018 13:16 | | @joao_gan | Reportar erro

26/11/2018 13:16 | | @joao_gan | Reportar erro





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A AMD dobrou o cache por CCX na camada L3 de seus processadores Epyc de 64 núcleos da geração Zen 2, codinome "Rome". É isso que revelam resultados da base de dados do SiSoft Sandra, que mostra em detalhe o funcionamento dos componentes do processador. 

Na captura de tela acima podemos ver destacada a informação "16 x 16 MB L3". Os processadores Epyc, fabricados em 7nm, contam com 8 chiplets e, segundo o TechPowerUp, a informação mostrada pelo SiSoft Sandra indica então que cada um desses chiplets de 8 núcleos conta com duas "fatias" de 16 MB de cache L3, e que seus núcleos são divididos em duas unidades CCX quad-core, cada uma com 16 MB de cache L3. Todo esse vai e volta de números significaria, no fim, o dobro de cache L3 por unidade CCX, ajudando na transferência de dados entre o chiplet e o die de I/O, algo bastante interessante levando-se em contar que são oito deles. 

AMD Epyc "Rome" de 7nm aparece em suposto benchmark do Cinebench R15 com 12.587 pontos

Dá pra ver na imagem também que os resultados são referentes a uma amostra de engenharia do processador. Claro que seria difícil de se imaginar que a AMD faria alguma mudança tão integralmente estrutural no design do processador até seu lançamento, mas é importante levar em conta que as informações ainda não são oficiais, nem de um produto finalizado.


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